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一、核心路径信息

字段名	说明	示例值	调试意义
Point	路径节点名称（时钟端口/寄存器引脚/组合逻辑/线网）	clk_i, regA/Q	定位时序路径关键节点
Incr	当前段增量延迟（ns/ps）	0.15ns	识别高延迟模块
Path	起点到当前节点的累积延迟	1.25ns	分析总路径长度
Arc	时序弧类型（如上升沿rising、建立时间setup）	rising_edge	确认信号触发方式

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二、电气特性

字段名	说明	示例值	调试意义
Fanout	当前节点驱动下级引脚数	3	>10需优化（插入Buffer）
Cap	总负载电容（pF/fF）	0.042pF	超标会导致延迟增加
Trans/Slew	接收端信号跃迁时间	0.08ns	正常范围：<时钟周期10%
Dtrans	驱动端信号跃迁时间	0.12ns	过大需增强驱动单元
Pin Cap	引脚输入电容	0.015pF	检查是否匹配驱动能力

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三、时序约束相关

字段名	说明	示例值	调试意义
Required	要求到达时间（Setup=捕获沿-建立时间）	2.50ns	对比Arrival Time判断违例
Slack	裕量=Required - Arrival	-0.10ns (VIOLATED)	负值需优化
Uncertainty	时钟抖动+偏斜预留量	0.05ns	过高需优化时钟树
Library Setup	寄存器建立时间要求（来自.lib）	0.25ns	工艺库固有值

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四、工艺与环境参数

字段名	说明	示例值	调试意义
Derate	延迟降额系数（OCV/PVT缩放）	1.10（延迟+10%）	>1.0表示悲观补偿
Delta	电压/温度变化导致的延迟增量	+0.05ns	动态电压调节（DVFS）场景关键参数
Process	工艺角（TT/FF/SS）	SS	慢速工艺角延迟最大
Voltage	工作电压	0.72V	低压模式延迟增加

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五、物理与结构信息

字段名	说明	示例值	调试意义
Cell	单元实例名称	U123	定位具体逻辑单元
Net	线网名称	net_abc	检查布线拥塞
Location	物理坐标（布局后可见）	(100.5, 200.3)	分析布局合理性

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六、完整示例报告

Point          Incr   Path   Dtrans  Derate  Delta   Fanout  Cap     Trans   Required  Slack      Cell
-------------------------------------------------------------------------------------------------------
clk_i (rise)   0.00   0.00   0.05    1.00    +0.00   1       0.02    0.05    2.50     2.50       N/A
regA/CLK       0.10   0.10   0.08    1.05    +0.01   1       0.03    0.08    2.40     2.30       DFFX1
regA/Q         0.15   0.25   0.12    1.10    +0.02   3       0.05    0.12    2.25     2.00       DFFX1
U1/Y           0.20   0.45   0.15    1.10    +0.03   2       0.07    0.15    2.05     1.60       AND2X1

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七、关键调试方法

1. Setup违例（Slack<0）

   • 检查 Incr 最大节点 → 优化组合逻辑或插入流水级。

   • 分析 Dtrans 和 Cap → 增强驱动或减小负载。

2. Hold违例

   • 关注 Delta 和 Derate → 调整OCV约束或增加缓冲延迟。

3. 时钟问题

   • Uncertainty 过高 → 优化时钟树综合（CTS）。

   • Latency 不均 → 平衡时钟路径。

4. 物理设计问题

   • Fanout 或 Cap 超标 → 手动布局或调整布线策略。

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八、扩展命令

• 查看单元属性：

  report_cell U1

• 分析线网负载：

  report_net -capacitance net_abc

• 检查时钟质量：

  report_clock -skew clk_core

通过此完整解析，可系统化定位时序瓶颈并指导综合、布局布线优化。